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n〓3, A14 : 설계된 메모리 모듈을 CPU의 address map에 유일하게 사상하기 위하여 이용 CPU A10-A0 D7-D0 A15 A14 A13 2KB RAM2 SA10-SA0 SD7-SD0 2KB RAM1 SA10-SA0 SD7-SD0 CS2 CS1 2KB RAM3 SA10-SA0 SD7-SD0 CS3 2KB RAM0 SA10-SA0 SD7-SD0 CS0 38 Decoder O4 O5 O6 O7 I1 : A12 I0 : A11 CS4 CS5 CS6 CS7 A12 A11 I0 : A13 O0 O1 O2 O3 CS0 CS1 CS2 CS3 2KB RAM6 SA10-SA0 SD7-SD0 2KB RAM5 SA10-SA0 SD7-SD0 CS6 CS5 2KB RAM7 SA10-SA0 SD7-SD0 CS7 2KB RAM4 SA10-SA0 SD7-SD0 CS4 E A15 A14 0xf123 〓 1111 0001 0010 0011 A15 : 1, 가장 높은 물리적 주소를 할당할 것) (CPU의 pin들 중 A15-A0, D7-D0 만을 사용할 것) 또, M〓14 2KByte SRAM을 이용할 경우 -` 2(11+3) bit : k〓14, 설계된 회로도에서 CPU의 입장에서 0xf123번지의 위치에 해당되는 메모리 소자를 표시하고 그 메모리 소자의 입장에서는 몇 번지에 해당되는가 (little endian 가정) 16KByte  ......

 

 

Index & Contents

컴퓨터공학 자료등록 하드웨어 s램 설계

 

[컴퓨터공학] 하드웨어 s램 설계

 

2K X 8bit의 SRAM을 이용하여 16bit의 주소를 가지고 있는

8bit 마이크로프로세서의 메모리 부 시스템을

공식에 따라 도면을 설계하시오

 

(이때, 메모리 부 시스템의 용량은 16K byte이며,

가장 높은 물리적 주소를 할당할 것)

 

(CPU의 pin들 중 A15-A0, D7-D0 만을 사용할 것)

또, 설계된 회로도에서 CPU의 입장에서 0xf123번지의 위치에

해당되는 메모리 소자를 표시하고

그 메모리 소자의 입장에서는 몇 번지에 해당되는가

(little endian 가정)

16KByte 〓` 2(14+3) bit : K〓17, N〓3, M〓14

2KByte SRAM을 이용할 경우 -` 2(11+3) bit : k〓14, n〓3, m〓11

단위 모듈 내 필요한 SRAM의 수 : 2(3-3) 〓 1

필요한 모듈의 수 : 2(14-11) 〓 8

m lines -`

A10-A0 : 모듈 내 메모리 소자의 address line으로 사용

M-m lines -`

A13-A11 : 8개의 모듈 중 하나를 선택하기 위하여 사용

A15, A14 : 설계된 메모리 모듈을

CPU의 address map에 유일하게 사상하기 위하여 이용

CPU

A10-A0

D7-D0

A15

A14

A13

2KB

RAM2

SA10-SA0

SD7-SD0

2KB

RAM1

SA10-SA0

SD7-SD0

CS2

CS1

2KB

RAM3

SA10-SA0

SD7-SD0

CS3

2KB

RAM0

SA10-SA0

SD7-SD0

CS0

38

Decoder

O4

O5

O6

O7

I1 : A12

I0 : A11

CS4

CS5

CS6

CS7

A12

A11

I0 : A13

O0

O1

O2

O3

CS0

CS1

CS2

CS3

2KB

RAM6

SA10-SA0

SD7-SD0

2KB

RAM5

SA10-SA0

SD7-SD0

CS6

CS5

2KB

RAM7

SA10-SA0

SD7-SD0

CS7

2KB

RAM4

SA10-SA0

SD7-SD0

CS4

E

A15

A14

0xf123 〓 1111 0001 0010 0011

A15 : 1, A14 : 1, A13 : 1, A12 : 1, A11 : 0

RAM6가 선택

RAM6로 입력되는 주소는

001 0010 0011 〓 0x123 번지

 

CPU

A10-A0

D7-D0

A15 (1)

A14 (1)

A13 (1)

2KB

RAM2

SA10-SA0

SD7-SD0

2KB

RAM1

SA10-SA0

SD7-SD0

CS2

CS1

2KB

RAM3

SA10-SA0

SD7-SD0

CS3

2KB

RAM0

SA10-SA0

SD7-SD0

CS0

38

Decoder

O4

O5

O6

O7

I1 : A12

I0 : A11

CS4

CS5

CS6

CS7

A12 (1)

A11 (0)

I0 : A13

O0

O1

O2

O3

CS0

CS1

CS2

CS3

2KB

RAM6

SA10-SA0

SD7-SD0

2KB

RAM5

SA10-SA0

SD7-SD0

CS6

CS5

2KB

RAM7

SA10-SA0

SD7-SD0

CS7

2KB

RAM4

SA10-SA0

SD7-SD0

CS4

E

A15

A14

001 0010 0011

(2) 64K X 8bit의 SRAM을 이용하여 20bit의 주소를 가지고 있는

 

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